VITEC SA Salaire

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Châtillon

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Les salaires sur les positions chez VITEC SA

Rémunération

Type de contrat

La langue

Responsabilité

participer à la définition des spécifications techniques en collaboration avec les équipes de conception et les responsables de projets
définition et mise en œuvre de l’architecture de l’ASIC, du concept au produit final
travailler avec le Product Owner, pour comprendre ses exigences et les traduire en spécifications techniques
collaborer étroitement avec les équipes interfonctionnelles, y compris l'équipe de validation, les équipes de logiciels embarqués et les responsables de projets
fournir des conseils techniques et du mentorat aux membres les moins expérimentés de l’équipes
concevoir des architectures FPGA hautement optimisées en tenant compte des contraintes de performance, de consommation d'énergie et de coût
suivre les tendances technologiques et les avancées dans le domaine FPGA, et les intégrer dans les projets en cours
S’assurer que l’architecture optimise les performances et la puissance de l’ASIC

Exigences

expérience dans la conception RTL et des langages VHDL et VERILOG
vous êtes diplômé d’une formation technique supérieure de niveau BAC+5 et vous justifiez d’au moins 10 ans d’expérience dans le monde complexe des ASIC
expérience dans la synthèse ASIC à l’aide d’outils tels que DC, SpyGlass, Questa CDC …
solides compétences en programmation matérielle en VHDL et/ou Verilog
expérience dans les bus NOC
expérience démontrée dans la conception d'architectures hautement optimisées en termes de performance, de consommation d'énergie et de coût
expérience dans les SOC
expérience dans la supervision d'équipes de conception et la gestion de projets complexes

2587 €